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母板 Stratix V Terasic TR5 FPGA Development Kit
 





TR5

Terasic TR5 FPGA Development Kit


FPGA Device

5SGXEA7N2F45C2N

  • 622K Logic Elements (LEs)
  • 57.16 Mbits 記憶體
  • 256 Variable-precision DSP Blocks
  • 512 18x18-bit Multipliers Blocks
  • 28 Fractional PLLs and 4DLLs
  • FPGA 亦有其他規格可供選擇,詳細資訊歡迎洽詢Terasic 銷售團隊。

FPGA 配置

  • 板載 USB Blaster II 或 JTAG 插口對 FPGA 程式設計
  •  通過 MAX II CPLD 和 Flash 配置快速被動平行 (FPPx16) 模式

記憶體

  • 128MB Flash with a 16-bit Data Bus
  • 2MB SSRAM (1M x 16)


DDR3 SO-DIMM 插槽

  • 可支援多達 8GB
  •  最大時鐘頻率可到 933 MHz


板載時鐘

  • 50 MHz  晶振
  • CDCM6208 可程式設計時鐘發生器
  • LMK04906B 可程式設計時鐘發生器


SMA 介面

  • 一對可用來作差分時鐘輸入與輸出的 SMA 介面


Buttons, Switches and LEDs

  • 4 個使用者控制 LEDs
  • 4 個按鈕
  • 4 個撥碼開關


Mini PCI Express Gen 2x4 介面

  • 支持 PCI Express Gen2 x4 (5.0Gbps/lanes)
  • 高速傳輸通道速率可達 5 Gbps
  • 支持 Downstream Mode
     

2個 SATA 介面

  • 符合 SATA3.0 傳輸率 6Gbps
     

4個 FPGA Mezzanine Card (FMC) 介面

  • 2個 HPC (high-pin count) FMC 介面可提供 172 x2 單端 I/O, 2 個 LPC (low-pin count) FMC 介面可提供 76 x2 單端 I/O
  • HPC FMC 以及 LPC FMC 介面分別能提供10以及1根 Transceiver 通道
  • 相容於FMC VITA 57.1 規範
  • 可調整 VADJ 電壓 : 1.2V/1.5V/1.8V/2.5V/3.0V.
  • 無法支持雙向LVDS功能, 由於Stratix V只支持單向LVDS.

一個 40-pin 擴充介面

  • 36 FPGA I/O 管腳; 4 個電源以及接地線
  • I/O 電壓准位元: 3.3V

電源 

  • DC 12V 輸入

功能區塊圖

 

FMC 擴充介面連接範例

 連接 FMC 子卡:  XTS-FMC 和 HDMI-FMC

 

連接 D8M-FMC FMC 子卡

 

連接 TI JESD 板透過 Terasic JESD-FMC 轉接卡

 

板跟板連接透過 FMC 連接線

透過 PCI Express 連介面擴充

透過 PCI 連接線 與 Terasic PCA 轉接卡來與 PC 連接

板跟板連接透過 PCIe 連接線  


透過 SATA介面擴充

板跟板連接透過 SATA 連接線

透過 GPIO介面擴充

連接 D5M 子卡


連接
MTL2  子卡

連接 LT24  子卡 



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